A3R12E40DBF-8E

Zentel Japan
155-A3R12E40DBF-8E
A3R12E40DBF-8E

Fabricante:

Descripción:
DRAM DDR2 512Mb, 32Mx16, 800 at CL5, 1.8V, FBGA-84

Hoja de datos:
Modelo ECAD:
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En existencias: 733

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Plazo de entrega de fábrica:
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Mínimo: 1   Múltiples: 1
Precio unitario:
₡-
Precio ext.:
₡-
Est. Tarifa:

Precio (CRC)

Cantidad Precio unitario
Precio ext.
₡1 908 ₡1 908
₡1 786 ₡17 860
₡1 734 ₡43 350
₡1 694 ₡84 700
₡1 653 ₡165 300
₡1 601 ₡400 250
₡1 578 ₡789 000
₡1 543 ₡1 543 000
₡1 479 ₡2 958 000

Atributo del producto Valor de atributo Seleccionar atributo
Zentel Japan
Categoría de producto: DRAM
RoHS:  
SDRAM - DDR2
512 Mbit
16 bit
400 MHz
FPGA-84
32 M x 16
400 ps
1.7 V
1.9 V
0 C
+ 85 C
DDR2
Tray
Marca: Zentel Japan
País de ensamblaje: Not Available
País de difusión: Not Available
País de origen: TW
Sensibles a la humedad: Yes
Estilo de montaje: SMD/SMT
Tipo de producto: DRAM
Cantidad de empaque de fábrica: 2000
Subcategoría: Memory & Data Storage
Corriente de suministro - Máx.: 65 mA
Nombre comercial: Zentel Japan
Peso de la unidad: 194 mg
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Atributos seleccionados: 0

Hoja de datos

CNHTS:
8542329010
USHTS:
8542320028
ECCN:
EAR99

DDR2 SDRAM

Zentel DDR2 SDRAM features a double-data-rate architecture with two data transfers per clock cycle. The high-speed data transfer is realized by the 4 bits prefetch pipelined architecture. A bi-directional differential data strobe (DQS and /DQS) is transmitted/received with data for capturing data at the receiver. DQS is edge-aligned with data for READs; center-aligned with data for WRITEs Differential clock inputs (CK and /CK). The DLL aligns DQ and DQS transitions with CK transitions.

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